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メモリーはECCをつけるなどで対策できそうだけど、FPGAだとどういう対策ができるんだろう。
ロジックがおかしくなるのを防止するには、定期的に Configuration しなおす。処理中のデータが化けるのを防ぐには、データに対してECCするのかな。
サーバ向けCPUやGPUだとかなり前から、ソフトエラー対策が入ってますよ。重要なレジスタを二重化したりしてる。そうしないと、数万CPU使うスパコン向けには使えないので、x86をスパコンに使い出した頃から対策が入ってて当時は学会でも発表されたました。既に確立した技術なので、今はあまり話題に上がりませんが。
もっと昔の大型機のロジックにはパリティが入っていました。パリティごと演算します。今は知らん。ECCじゃなくてパリティということは、実際にはおきないという判断です。
二重化はパリティと同じです。最近のはノードがダウンしてもシステムダウンにならないとか、そういう判断で二重化なのかな。
FPGAは昔から宇宙用・軍用のRadhard品が供給されているので、それを使えということなのでしょうRadhardタイプの無い高集積・最先端製品は対策お手上げということで.....＃FPGAのコンフィギュレーションだけを問題にするのなら旧Actelのアンチヒューズ・タイプがおすすめ
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ハッカーとクラッカーの違い。大してないと思います -- あるアレゲ
対策方法 (スコア:1)
メモリーはECCをつけるなどで対策できそうだけど、
FPGAだとどういう対策ができるんだろう。
ロジックがおかしくなるのを防止するには、定期的に Configuration しなおす。
処理中のデータが化けるのを防ぐには、データに対してECCするのかな。
Re: (スコア:3, 参考になる)
サーバ向けCPUやGPUだとかなり前から、ソフトエラー対策が入ってますよ。
重要なレジスタを二重化したりしてる。
そうしないと、数万CPU使うスパコン向けには使えないので、x86をスパコンに使い出した頃から対策が入ってて当時は学会でも発表されたました。
既に確立した技術なので、今はあまり話題に上がりませんが。
Re: (スコア:1)
Re: (スコア:0)
もっと昔の大型機のロジックにはパリティが入っていました。パリティごと演算します。今は知らん。
ECCじゃなくてパリティということは、実際にはおきないという判断です。
二重化はパリティと同じです。最近のはノードがダウンしてもシステムダウンにならないとか、
そういう判断で二重化なのかな。
Re: (スコア:1)
// 全ビットにパリティでも用意するか?
Re:対策方法 (スコア:0)
FPGAは昔から宇宙用・軍用のRadhard品が供給されているので、それを使えということなのでしょう
Radhardタイプの無い高集積・最先端製品は対策お手上げということで.....
＃FPGAのコンフィギュレーションだけを問題にするのなら旧Actelのアンチヒューズ・タイプがおすすめ